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问题提出：多位加法器依赖于单位加法器串联，那么多位加法器在计算过程中，进位的传递具有时间先后性，高位的进位依赖于所有地位的进位计算，这样导致了木桶效应，最终计算效率取决于高维进位的传递时间，减缓了加法计算效率。
问题解决：并行加法器，通过单独设计逻辑电路，使得高位加法器在同时执行一个较长的逻辑电路，缩短了得出进位的时间。
方案不足：越高位的加法器需要的电路越复杂，增大了成本开销，并且越复杂的电路时间越慢。所以一般只设计四位
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